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第1篇 fpga邏輯開發(fā)工程師崗位職責(zé)
fpga邏輯開發(fā)工程師 凌云光技術(shù) 凌云光技術(shù)集團有限責(zé)任公司,凌云光技術(shù),凌云集團,凌云光 崗位職責(zé):
1.負(fù)責(zé)圖像處理、相機成像相關(guān)的fpga程序設(shè)計;
2.承擔(dān)已有fpga程序的維護(hù)工作;
3.承擔(dān)圖像算法的fpga移植;
4.編寫必要的設(shè)計及測試相關(guān)文檔。
任職要求:
1.本科以上學(xué)歷,電子類相關(guān)專業(yè);
2.熟悉ccd/cmos成像原理,了解光電檢測相關(guān)行業(yè),有fpga開發(fā)經(jīng)驗
3.熟悉verilog、vhdl等硬件描述語言;
4.有2年以上fpga實際開發(fā)經(jīng)驗;
5.熟悉各種通信協(xié)議如spi、rs232、i2c等。
第2篇 游戲邏輯開發(fā)工程師崗位職責(zé)
游戲服務(wù)端邏輯開發(fā)工程師 西山居 成都西山居互動娛樂科技有限公司珠海分公司,西山居,西山居游戲,西山居 職責(zé)
負(fù)責(zé)實現(xiàn)游戲功能模塊
與策劃密切協(xié)作完成功能開發(fā)
要求
本科以上學(xué)歷,計算機相關(guān)專業(yè)
使用c++/lua開發(fā)完成工作
熱愛游戲,具備樂觀積極的工作態(tài)度,注重細(xì)節(jié),有較強的溝通理解能力和團隊合作精神
第3篇 邏輯開發(fā)工程師崗位職責(zé)范本
1.從事邏輯代碼編寫、方案設(shè)計與測試。
2.從事邏輯設(shè)計驗證、驗證語言工具開發(fā)與應(yīng)用。
3.從事邏輯技術(shù)的研究分析、開發(fā)與應(yīng)用。
第4篇 fpga邏輯開發(fā)工程師崗位職責(zé)fpga邏輯開發(fā)工程師職責(zé)任職要求
fpga邏輯開發(fā)工程師崗位職責(zé)
fpga開發(fā)工程師/數(shù)字邏輯工程師 崗位描述:
1)作為一個產(chǎn)品或者一個核心模塊主要開發(fā)工程師;
2)承擔(dān)一個產(chǎn)品或者一個核心模塊維護(hù)和功能升級;
3)作為重點問題或者需求的核心攻關(guān)力量
崗位要求:
3年及以上工作經(jīng)驗。是做fpga設(shè)計或者驗證，asic設(shè)計或者驗證也可以，算法相關(guān)不做要求。
必備經(jīng)驗:
開發(fā):精通verilog或者vhdl。熟練使用altera或者_(dá)ilin_綜合、時序分析工具，如果是做asic，要熟悉相應(yīng)的綜合工具。
驗證:精通system verilog，uvm方法學(xué)。熟練使用modelsim、questasim、vcs等仿真工具
fpga開發(fā)工程師(junior)3名
崗位描述
1)維護(hù)或者開發(fā)特定需求的功能模塊;
2)繼承已有產(chǎn)品，完成新產(chǎn)品;
3)作為功能較為簡單的產(chǎn)品主要開發(fā)工程師;
崗位要求:
1-3年工作經(jīng)驗:本科生及以上。
必備經(jīng)驗:
開發(fā):熟練使用verilog或者vhdl。熟練使用altera或者_(dá)ilin_綜合、時序分析工具，如果是做asic，要熟悉相應(yīng)的綜合工具。
驗證:熟練使用system verilog，uvm方法學(xué)。熟練使用modelsim、questasim、vcs等仿真工具
崗位描述:
1)作為一個產(chǎn)品或者一個核心模塊主要開發(fā)工程師;
2)承擔(dān)一個產(chǎn)品或者一個核心模塊維護(hù)和功能升級;
3)作為重點問題或者需求的核心攻關(guān)力量
崗位要求:
3年及以上工作經(jīng)驗。是做fpga設(shè)計或者驗證，asic設(shè)計或者驗證也可以，算法相關(guān)不做要求。
必備經(jīng)驗:
開發(fā):精通verilog或者vhdl。熟練使用altera或者_(dá)ilin_綜合、時序分析工具，如果是做asic，要熟悉相應(yīng)的綜合工具。
驗證:精通system verilog，uvm方法學(xué)。熟練使用modelsim、questasim、vcs等仿真工具
fpga開發(fā)工程師(junior)3名
崗位描述
1)維護(hù)或者開發(fā)特定需求的功能模塊;
2)繼承已有產(chǎn)品，完成新產(chǎn)品;
3)作為功能較為簡單的產(chǎn)品主要開發(fā)工程師;
崗位要求:
1-3年工作經(jīng)驗:本科生及以上。
必備經(jīng)驗:
開發(fā):熟練使用verilog或者vhdl。熟練使用altera或者_(dá)ilin_綜合、時序分析工具，如果是做asic，要熟悉相應(yīng)的綜合工具。
驗證:熟練使用system verilog，uvm方法學(xué)。熟練使用modelsim、questasim、vcs等仿真工具
